VGA矩阵接口原理 品牌:韦斯 型号:WIS-HDCAP2.0 产地:北京 产品注册号:无 用途: 医用 招商状态:招商中 招商区域:全国 浏览量:32674 | 北京韦斯达通科技有限公司 联系时请告知消息来自3618医疗器械网,您会获得更多的优惠或支持 联系人:****** 联系电话:****** |
矩阵切换的概念
矩阵的概念引用高数中的线性代数的概念,一般指在多路输入的情况下有多路的输出选择,形成下图的矩阵结构,既每一路输出都可与不同的输入信号“短接”,每路输出只能接通某一路输入,但某一路输入都可(同时)接通不同的输出,如下图。 输出1=输入1,输出2=输入2,而输出3=输出4=输入3,或者说,每一路输出可“独立”地在输入中进行选择,而不必关心其它通道的输出情况,即可以与其它输出不同,也可以相同。举例说,8选4是指有4个独立的输出,每个输出可在8个输入中任选,或者说有4个独立的8选1,只是8个输入是相同的。经常与此混淆的是分配的概念,比如8选1分4,是指在8个输入中选择出1个输出,并将其分配成4个相同的输出,虽然外观上看有4个输出,但这4个输出是相同的,而不是独立的。一般习惯中,将形成M×N的结构称为矩阵,而将M×1的结构称为切换器或选择器,其实不过N=1而已,我们在讨论时都当作矩阵对待。
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VGA矩阵接口原理概述及原理
VGA显示与VGA时序实现
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3 读SRAM地址的产生方法 主时钟作为像素点计数脉冲信号,同时提供显存SRAM的读信号和D/A转换时钟,它所驱动的计数器的 输出端作为读SRAM的低位地址。行同步信号作为行数计数脉冲信号,它所驱动的计数器的输出端作为读 SRAM的高位地址。由于采用两片SRAM,所以高位地址作为SRAM的片选使用。由于信号经过CPLD内部逻辑 器件时存在一定的时间延迟,在CPLD产生地址和读信号读取数据时,读信号、地址信号和数据信号不能满 足SRAM读数据的时序要求。可以利用硬件电路对读信号进行一定的时序调整,使各信号之间能够满足读 SRAM和为DAC输入数据的时序要求。
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